Circuits intégrés électroniques

CEA/Saclay

Étude, réalisation et fourniture d'un ensemble d'asic (identiques) pour le diagnostic de câbles. Le CEA LIST étudie des systèmes pour le diagnostic de réseaux filaires complexes; il souhaite réaliser un démonstrateur intégré. Le titulaire aura en charge les prestations suivantes relatives à la fourniture d'un ensemble d'asic (les chiffres des blocs indiqués ci-après sont donnés à titre purement indicatif): — Le design des blocs analogiques (ADC 8-10 bits 20ms/s et DAC 8-10 bits 150ms/s, tr<2.5ns) à l'exception du bloc DLL (qui sera à la charge du CEA au titre de la tranche ferme), —l'assemblage des blocs analogiques comportant un bloc DLL, — Une simulation complète après assemblage des blocs analogiques à partir d'un bloc de génération de stimuli numériques, de modèles VHDL-AMS de la charge externe du circuit et d'un testbench fournis, —l'asssemblage et placement - routage de la partie numérique et de la partie analogique pour la réalisation de la "top cell". La partie numérique sera fournie par le CEA et la bonne intégration de cette dernière devra être facilitée (avec la fourniture du floorplan par exemple) par le titulaire et se fera sous sa responsabilité, — Le lancement de la production d'un lot de puces (environ 50) sur cible technologique ST 130 nm MPW. Le test et la caractérisation seront à la charge du CEA avec un support éventuel de la part du titulaire, — Le titulaire devra fournir l'ensemble des livrables nécessaires à la réalisation du marché (à l'exception du DLL).

Le délai de réception des offres était de 2010-11-15. L'appel d'offres a été publié le 2010-10-12.

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